發布者:BACKUPDATA
發布日期:2019-05-14主控制柜操作模式下(主/從=1即MASTER/SLAVE=1),SPI通過SPICLK(時鐘)引腳為整個串行通信網路提供串行時鐘。數據將從SPISIMO(從控制器輸入,主控制柜輸出)引腳輸出,并將鎖存SPISOMI(從控制器輸出,主控制柜輸入)引腳輸入的數據。SPIBRR寄存器(波特率寄存器)可以配置126種不同的位傳輸率,該寄存器決定了整個串行通信網絡發送和接收數據的位傳輸率。寫入SPIDAT(串行數據寄存器)或SPITXBUF(串行輸出緩沖寄存器)的數據啟動SPISIMO引腳的數據傳送,數據較高 位(M)較早發送。與此同時接收的數據通過SPISOMI引腳移入SPIDAT的較低 位(L)。當設定的位發送完畢后,已接收的數據移人SPIRXBUF(串行輸入緩沖寄存器)供CPU讀取。數據以右對齊的方式存儲于SPIRXBUF寄存器中。
當指定數量的數據已經通過SPIDAT寄存器移出后,則會引起下列事件:
1)SPIDAT寄存器中內容已經發送到SPIRXBUF寄存器。
2)SPI中斷標志位(SPISTS.6)置高電平。
3)如果SPISTS的TXBUF FUILL位指示在串行發送緩沖寄存器SPITXBUF中有 的數據,則該數據將被傳送到SPIDAT寄存器并發送出去;否則,所有位從SPIDAT寄存器移除后,SPIDAT時鐘立即停止。
4)如果SPI中斷使能位(SPICTL.0)置高電平,則產生中斷。
在典型應用中,SPISTE引腳用作從SPI控制器的片選控制信號。主控制柜發送數據給從榨制器前將SPISTE引腳置為低電平,待數據發送完畢后再將SPISTE引腳置為高電平。
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